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Verilog HDL数字系统设计书籍详细信息
- ISBN：9787560331690
- 作者：暂无作者
- 出版社：暂无出版社
- 出版时间：2011-6
- 页数：356
- 价格：44.00元
- 纸张：暂无纸张
- 装帧：暂无装帧
- 开本：暂无开本
- 语言：未知
- 丛书：暂无丛书
- TAG：暂无
- 豆瓣评分：暂无豆瓣评分
内容简介：
《Verilog HDL数字系统设计》由王建民、田晓华、江晓林编著，通过
大量完整的实例介绍基于Verilog HDL进行数字系统设计的基本原理、概念
和方法。全书重点关注基于HDL的寄存器传输级(Register Transfer Level
，RTL)数字系统设计，主要内容包括数字电路基础回顾、组合逻辑电路设计
、规则时序逻辑电路、有限状态机以及FSMD的设计。本书所有代码兼容
Verilog HDL IEEE1364—2001标准。
尽管本书简单地回顾了数字电路的基本知识，但是如果读者能够掌握数
字电路的基本原理和设计方法对于阅读本书将是十分有意义的。本书适合高
年级的本科生、研究生以及从事数字电路设计的工程人员使用。
书籍目录：
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作者介绍：
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出版社信息：
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原文赏析：
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其它内容：
书籍介绍
《Verilog HDL数字系统设计》由王建民、田晓华、江晓林编著，通过
大量完整的实例介绍基于Verilog HDL进行数字系统设计的基本原理、概念
和方法。全书重点关注基于HDL的寄存器传输级(Register Transfer Level
，RTL)数字系统设计，主要内容包括数字电路基础回顾、组合逻辑电路设计
、规则时序逻辑电路、有限状态机以及FSMD的设计。本书所有代码兼容
Verilog HDL IEEE1364—2001标准。
尽管本书简单地回顾了数字电路的基本知识，但是如果读者能够掌握数
字电路的基本原理和设计方法对于阅读本书将是十分有意义的。本书适合高
年级的本科生、研究生以及从事数字电路设计的工程人员使用。
书籍真实打分
故事情节：7分
人物塑造：5分
主题深度：3分
文字风格：7分
语言运用：4分
文笔流畅：8分
思想传递：4分
知识深度：8分
知识广度：5分
实用性：4分
章节划分：8分
结构布局：5分
新颖与独特：5分
情感共鸣：3分
引人入胜：8分
现实相关：4分
沉浸感：7分
事实准确性：9分
文化贡献：3分
网站评分
书籍多样性：5分
书籍信息完全性：5分
网站更新速度：6分
使用便利性：8分
书籍清晰度：9分
书籍格式兼容性：3分
是否包含广告：6分
加载速度：5分
安全性：8分
稳定性：7分
搜索功能：8分
下载便捷性：9分
下载点评
- 下载快(520+)
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- 强烈推荐(421+)
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- 盗版少(566+)
下载评价
网友 孙***夏：中评，比上不足比下有余
网友 宫***凡：一般般，只能说收费的比免费的强不少。
网友 戈***玉：特别棒
网友 訾***雰：下载速度很快，我选择的是epub格式
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网友 索***宸：书的质量很好。资源多
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网友 冯***丽：卡的不行啊